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Los arreglos de compuertas programables en campo (FPGA) (página 2)




Enviado por Pablo Turmero



Partes: 1, 2, 3

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Spartan-3: Diagrama simplificado de un Slice
(Gp:) flip-flops

(Gp:) LUTs

(Gp:) lógica de carry

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Spartan-3: Slices dentro del CLB

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Celda lógica de una FPGA (Spartan-3)
La celda lógica está conformada por tres elementos:
LUT (Look-Up Table) de 4 entradas
Multiplexor
Flip-flop

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Celda lógica de una FPGA (Spartan-3)
La LUT se implementa con una memoria SDRAM, por lo que se puede usar como:
Una LUT de 4 entradas
Una memoria de 16×1 bit
Un registro de deplazamiento (16 bits)

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Lógica combinacional dentro de una FPGA
La lógica combinacional se conforma a través de tablas (Look-Up Tables, LUTs)
También son denominadas Generadores de funciones
(FG: Function Generators)
Su capacidad está dada por la cantidad de entradas
El retardo a través de ellas es constante

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Lógica combinacional dentro de una FPGA
Función a implementar
Tabla de verdad
LUT programada

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Multiplexores
Son elementos dedicados a proveer interconexión entre slices y LUTs
MUXF5
Combina 2 LUTs para formar
cualquier función de 5 variables

MUXF6
Combina 2 slices para formar
cualquier función de 6 variables

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¿Cómo se implementaría una
función de 5 variables?
LUT
LUT
(Gp:) MUX

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Bloque de entrada / salida (IOB)
Soportan flujo bidireccional
Salidas configurables como tri-state
Resistencias de pull-up y pull-down programables
Soportan varios estándares de señales (incluye señales diferenciales)
Brinda la posibilidad de registrar tanto entradas como salidas
Control Digital de Impedancia (DCI) para matchear con las líneas que
llegan a la FPGA

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Bloque de entrada / salida (IOB) (Spartan-3)

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IOB (Spartan-3)

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Conexiones programables (Spartan-3)
Líneas de propósito general
Líneas largas
Líneas directas
Tipos de líneas de interconexión:
Proporcionan distintas opciones
para la interconexión de los
distintos elementos de manera
flexible y eficiente

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Conexiones programables (Spartan-3)
Son un conjunto de líneas horizontales y verticales conectadas a una matriz de interconexión (switch matrix)
Líneas de propósito general

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Conexiones programables (Spartan-3)
Son un conjunto de líneas horizontales y verticales conectadas a una matriz de interconexión (switch matrix)
Matriz de interconexión
(Gp:) Configuración

(Gp:) Cada punto de interconexión
está formado por 6 transistores
Son interruptores programables

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Conexiones programables (Spartan-3)
Son líneas que atraviesan la FPGA de arriba abajo y
de izquierda a derecha
Permiten un fan-out grande
Se utilizan para que una señal acceda a un punto
distante, con menos retardos que las líneas de
propósito general
Son un recurso escaso y son dedicadas para señales
críticas tales como el reloj o señales de inicialización
globales.
Líneas largas

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Conexiones programables (Spartan-3)
Son líneas de conexión
directa entre bloques
Se utilizan para implementar
redes entre los CLBs e
IOBs adyacente, de manera
eficiente
Introducen retardos mínimos
Líneas directas

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Block RAM (Spartan-3)
Esta generación de FPGAs posee bloques de memoria
que mediante diferentes configuraciones permiten crear
RAMs, ROMs, FIFOs, LUTS grandes, buffers circulares,
y registros de desplazamiento.
Se encuentran cerca de los multiplicadores para acelerar
la implementación de operaciones multiply-accumulate
Cuando en vez de usar Block RAMs se utilizan las LUTs se dice
que se hace uso de memoria distribuida.

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Spartan-3: Ubicación de la Block RAM

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Spartan-3: Block RAM (config. de cada bloque)
Tabla extraída de “Spartan-3 Generation FPGA User Guide”

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Spartan-3: Block RAM total
Tabla extraída de “Spartan-3 Generation FPGA User Guide”

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Spartan-3: Block RAM
Imagen extraída de “Spartan-3 Generation FPGA User Guide”

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Spartan-3: Block RAM
Primitivas

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Spartan-3: Multiplicador
Cuenta con 20 multiplicadores embebidos de 18 bits de
operando y 36 bits de salida.
Se encuentran al lado de los bloques de memoria

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Spartan-3: Multiplicador

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